为加速芯片和电子系统创新而提供软件、知识产权（IP）及服务的全球性领先供应商新思科技公司（Synopsys， Inc.，纳斯达克股票市场代码：SNPS）日前宣布：推出其名为“IP Accelerated”的IP加速计划，以帮助设计师显著地减少在其系统级芯片（SoC）中集成IP所需的时间和工作量。该计划扩展了Synopsys已有的、多样化的、已流片验证过的DesignWare® IP产品组合，增加了全新的IP Prototyping Kits原型设计套件、IP Virtual Development Kits虚拟原型开发套件和定制化IP子系统，加速了原型设计、软件开发以及将IP集成到SoC中。通过IP Accelerated加速计划，Synopsys超越了传统IP供应商的范畴，重新定义了客户可从其IP供应商处所期待得到的产品与服务，以帮助设计师通过更省力、更低风险以及更短上市时间的方式成功地实现IP集成。

随着SoC硬件和软件越来越复杂，开发人员对IP供应商的需求也越来越多，以帮助他们满足其项目计划。仅凭传统的IP单元块已经不足以应对日益增长的SoC设计和集成挑战。设计师需要一种可以简化IP配置和整个SoC集成的、同时加速其软件开发工作的解决方案。Synopsys IP Accelerated计划提供的解决方案可以帮助设计师应对在IP实现、软件开发和IP集成过程中的挑战。

“由于设计复杂度不断提高、设计成本逐渐上升以及上市时间日趋缩短，预计从2012年到2018年间，第三方IP的使用量将增加一倍以上，”Semico Research公司ASIC和SoC的高级市场分析师Richard Wawrzyniak表示：“像Synopsys一样，越来越多的公司开始转向第三方IP供应商，以便为客户提供诸如IP Accelerated加速计划这样的全面解决方案，以缩减开发成本、降低集成风险同时满足其市场计划。”

DesignWare IP Prototyping Kits原型设计套件

DesignWare IP Prototyping Kits原型设计套件的核心是一款经过验证的参考设计，它使设计师在几分钟内就能够在SoC环境中开始实现IP。IP Prototyping Kits原型系统设计套件提供了所需的关键性硬件和软件单元，以减少IP原型设计和集成工作量，其中包括带有预配置IP和SoC集成逻辑的Synopsys HAPS-DX基于FPGA的原型设计系统、一块PHY子板、仿真测试平台，以及一个可运行在Linux上的基于物理或虚拟早期软件的启动、调试和测试并易于修改的DesignWare ARC®处理器的32位软件开发平台、参考驱动软件和应用案例。设计者可以根据目标应用，通过一个快速迭代流来修改标准的IP配置，该流程环境包括Synopsys的coreConsultant IP配置工具、Synopsys的ProtoCompiler综合和调试工具以及编译脚本。

“由于我们预算的50%都花在了软件开发，我们必需要拥有更深入的系统专业知识，以更好的支持我们的客户，”DisplayLink公司全球销售和营销的资深副总裁John Cummins表示：“我们不仅需要关注获得各个独立IP单元，而且还要关注IP在整个SoC环境中的集成和验证。Synopsys的IP Accelerated计划一举中的，满足直接影响公司IP软件开发和SoC集成能力的关键需求。”

图片：Synopsys DesignWare IP Prototyping Kit原型设计套件

DesignWare IP Virtual Development Kits虚拟原型开发套件

DesignWare IP Virtual Development Kits虚拟原型开发套件是由一个基于多核ARM Cortex-A57 Versatile Express的参考设计和一个可配置DesignWare IP模型组成的软件开发套件。该IP Virtual Development Kits虚拟原型开发套件可运行Linaro Linux，同时包括用于DesignWare IP的参考驱动软件并提供了非侵入式调试的可控性和可见性。

软件开发人员能够采用IP Virtual Development Kits虚拟原型开发套件或者IP Prototyping Kits原型设计套件都作为经过验证的目标，用于SoC开发的同时进行早期软件开发、快速启动、调试和测试。对Linux软件栈即刻可用的支持确保了软件开发人员可立即启动和运行并集中在IP专用软件（例如驱动程序、引导代码、固件）上。

IP Virtual Development Kits虚拟原型开发套件和IP Prototyping Kits原型设计套件两者都能够轻松地插入到现有的软件工具链中，并无缝地与最受欢迎的嵌入式软件调试系统建立接口，以提供系统级的调试和分析功能。该套件能够轻松地被扩展以代表整个SoC，确保提前并加速整个板级支持包（BSP）的开发。

“由于软件的规模和复杂度在不断地增长，半导体公司正在寻找一种全新解决方案，以降低嵌入式软件开发不断增长的成本和工作量，”VDC Research的M2M和嵌入式技术执行副总裁Chris Rommel表示道：“随着半导体公司现在将其50%以上的开发工作量放到了软件之上，Synopsys的DesignWare IP Virtual Development Kit虚拟原型开发套件将使企业在日益由软件驱动的市场中能够保持竞争力。”

子系统集成专业知识

凭借在IP子系统集成方面的丰富知识，Synopsys专家可以协助设计师针对其特定的应用需求来定制DesignWare IP，同时将IP集成到客户的SoC中。客户可以借助Synopsys的IP专业知识来获得预先验证过的、完全集成的子系统，从而降低整体工作量以及IP构建和集成的成本。设计师可以专注于其SoC的差异化，而不是开发或集成基于标准的IP。

“我们的客户一直面临着巨大的上市时间压力以保持竞争力，并且，显而易见的是传统的IP供应方式已经不足以满足他们的需求，”Synopsys副总裁兼解决方案事业部总经理Joachim Kunkel表示：“客户对其IP供应商的期待越来越高，以应对爆发性的软件工作量及其芯片不断增长的复杂度。Synopsys的IP Accelerated加速计划，包括了全新的IP Prototyping Kits原型设计套件、IP Virtual Development Kits虚拟开发套件以及定制化的子系统，能够帮助设计师实现更快速的IP原型设计、更容易的IP集成以及更早进行软件开发。”

供货与资源

用于精选的DesignWare IP Prototyping Kits原型设计套件和IP Virtual Development Kit虚拟原型开发套件现在已经开始供货。

关于DesignWare IP

新思科技（Synopsys）是一家为各种SoC设计提供高质量并经硅验证IP解决方案的领先供应商，其丰富的DesignWare IP产品组合包括完整的接口IP解决方案（包括支持多种常用协议的控制器、PHY和下一代验证IP），模拟IP，各种嵌入式存储器，逻辑库，处理器解决方案和子系统。为了支持软件开发及IP的软硬件集成，Synopsys还为其多种IP产品提供驱动软件、事务级模型和原型。Synopsys的 HAPS®基于FPGA的原型解决方案支持在系统环境中验证IP和SoC。Synopsys的Virtualizer™虚拟原型工具箱使开发人员能够比传统方法提前很久就开始为IP或者整个SoC开发软件。凭借一种稳健的IP开发方法学，以及在质量、IP原型、软件开发及综合性技术支持等领域内的大力投入，Synopsys使设计师能够加快产品的上市并降低集成风险。

关于Synopsys

Synopsys有限公司（Nasdaq:SNPS）加速了全球电子市场中的创新。作为电子设计自动化（EDA）和半导体IP领域内的领导者，Synopsys提供的软件、IP和设计服务可帮助工程师应对设计、验证、系统和制造中的各种挑战。自1986年以来，世界各地的工程师使用Synopsys的技术已经设计和创造了数十亿个芯片和系统。