介绍了一种应用VHDL语言设计数字锁相环的设计方法, 阐明其基本工作原理和设计思想, 给出了系统主要模块的设计过程和仿真结果; 用可编程逻辑器件FPGA予以实现。该方案提高了DPLL的快速锁定性能, 同时保证了锁定精度。
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