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[ 文章 ] verilog HDL 的阻塞和非阻塞语句分析

阻塞和非阻塞语句作为verilog HDL语言的最大难点之一，一直困扰着FPGA设计者，即使是 ...

by Dabing | 发表时间 2015-02-03 |907次查看
[ 文章 ] FPGA设计者的5项基本功

在我看来，成为一名说得过去的FPGA设计者，需要练好5项基本功：仿真、综合、时序分析、调试、验证。需 ...

by 晴空万里 | 发表时间 2014-07-29 |830次查看
[ 文章 ] FPGA设计的5项基本功

在我看来，成为一名说得过去的FPGA设计者，需要练好5项基本功：仿真、综合、时序分析、调试、验证。 ...

by hcay | 发表时间 2014-12-09 |699次查看
[ 文章 ] FPGA设计者的五项基本功

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by 永不止步步 | 发表时间 2014-02-24 |610次查看