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看Xilinx的Datasheet会注意到Xilinx的FPGA没有PLL，其实DCM就是时间管理单 ...
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畅学电子 | 发表时间 2014-09-18
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在程序中将一些以前调试而没有删除的变量删除了，编译就果断ok了，问题是解决了，但是觉得自己关于cmd ...
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凯瑞 | 发表时间 2015-05-13
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FPGA驱动LCD1602，其实就是通过同步状态机模拟单片机驱动LCD1602，由并行模拟单步执行， ...
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期待 | 发表时间 2015-04-09
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d触发器时序图怎么画 D触发器就是把信号延迟一个时钟周期，T触发器是翻转触发器。 D触发器（data ...
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lotuse | 发表时间 2016-10-09
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使用SpecctreQuest 打开*.brd，进行必要设置，通过处理直接得到结果。这实际与上述方式 ...
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一帘幽梦飞 | 发表时间 2014-11-06
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介绍一种利用Altera公司CycLone II系列FPGA和第2代软核处理器Nios II的误码率 ...
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lihong | 发表时间 2016-03-02
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对于一个module中同一个输入输出或者变量在一个always语句中赋值。同时为了增强代码的可读性， ...
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永不止步步 | 发表时间 2015-06-08
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input wire clk, ...
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一帘幽梦飞 | 发表时间 2014-10-27
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蓝牙无线技术是使用范围最广泛的全球短距离无线标准之一，蓝牙4．0规范的核心是蓝牙低功耗(Blueto ...
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州仔 | 发表时间 2013-11-07
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以TMS320F28027为代表的TI C28x PiccoLo系列微处理器采用了以SOC为基础的A ...
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永不止步步 | 发表时间 2014-06-06
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该系统主要由车载终端和监测中心组成，车载终端由STM32F103RBT6中央控制器、GPS定位模块U ...
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永不止步步 | 发表时间 2014-05-28
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在基于Linux的AM335x软件开发流程中，第一步就是U-Boot/SPL（SecondProgr ...
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永不止步步 | 发表时间 2014-08-22
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VeriLogHDL/VHDL开发之VeriLog实现冒泡排序 ...
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lotuse | 发表时间 2016-09-23
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导读： 可编程逻辑控制器（Programmable Logic Controller，PLC），它采 ...
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一帘幽梦飞 | 发表时间 2014-10-16
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Vivado可以将自己的veriLog代码设计封装成IP，然后在设计中调用该ip.ip还可以配置参数 ...
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期待 | 发表时间 2015-04-11
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美国科技博客The Next Web今天刊登题为《为什么越来越多的亚洲应用开发者对Android的重 ...
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州仔 | 发表时间 2014-02-28
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Altera FPGA分为两大类，一种侧重低成本应用，容量中等，性能可以满足一般的逻辑设计要求，如C ...
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Dabing | 发表时间 2015-02-04
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在SpecctraQuest 里的Logic 下拉菜单里，选择create list of nets ...
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一帘幽梦飞 | 发表时间 2014-11-06
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在VeriLog中最常用的编码方式有二进制编码(Binary)、格雷码(Gray-code)编码、独 ...
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一帘幽梦飞 | 发表时间 2014-10-14
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SPI，是英语Serial Peripheral Interface的缩写，顾名思义就是串行外围设备 ...
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期待 | 发表时间 2015-04-09
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