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随着仪表放大器的成本日益下降，在传统上采用运算放大器的应用中，使用仪表放大器可提升性能。 ...
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倩倩 | 发表时间 2014-06-12
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加法器是产生数的和的装置。加数和被加数为输入，和数与进位为输出的装置为半加器。若加数、被加数与低 ...
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粽子糖果 | 发表时间 2018-02-22
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今天看到群里面的几位要找工作的小朋友在晒笔试题，其中有一道是如何用32bit的加法器和逻辑门实现两个 ...
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永不止步步 | 发表时间 2015-06-08
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加法器是为了实现加法的。即是产生数的和的装置。加数和被加数为输入，和数与进位为输出的 ...
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粽子糖果 | 发表时间 2018-02-22
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m序列是最长线性反馈移位寄存器序列的简称，它是由带线性反馈的移位寄存器产生的周期最长的一种伪随机序列 ...
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露水非海 | 发表时间 2015-12-07
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由于串行多位加法器的高位相加时要等待低位的进位，所以速度受到进位信号的限制而变慢，人们又设计了一种多 ...
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期待 | 发表时间 2015-04-21
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本文给大家分享了通用加法器(741、1458)电路图。 ...
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小尚 | 发表时间 2016-01-09
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在FPGA上实现单精度浮点加法器的设计,通过分析实数的IEEE 754表示形式和IEEE 754单精 ...
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由于在网上和书上看到的流水线结构全是基于阻塞赋值的，结果输出是正确的（大部分时间），但是存在亚稳态的 ...
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一帘幽梦飞 | 发表时间 2014-10-14
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多数FPGA不支持浮点运算，这使FPGA在数值计算、数据分析和信号处理等方面受到了限制，由于FPGA ...
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Dabing | 发表时间 2015-03-31
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与传统加法器相比，数字串行加法器具有工作频率高、占用资源少、设计灵活等优点。介绍了数字串行加法器的原 ...
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Dabing | 发表时间 2015-01-31
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设计了一种支持IEEE754浮点标准的32位高速流水线结构浮点乘法器。该乘法器采用新型的基4布思算法 ...
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宝啦宝呀 | 发表时间 2015-05-11
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全加器实现的基本原理是基于进位传播和进位产生的PG逻辑。根据现有的PG逻辑计算公式,本文推导出一种新 ...
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期待 | 发表时间 2015-05-23
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在电子学中，加法器是一种数位电路，其可进行数字的加法计算。加法器是产生数的和的装置。加数和被加数为输 ...
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lotuse | 发表时间 2016-11-03
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在X87执行环境下，采用基于Two-Path算法的并行深度流水线优化算法，设计了一种能够实现符合I ...
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AJ代发 | 发表时间 2016-05-04
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之前写过一篇关于 “加法器” 的博文，研究了加法器的底层电路，本来想要研究一下“行波时钟”，由于涉及 ...
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永不止步步 | 发表时间 2015-10-14
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基于抽取滤波器的工作原理，本文采用XC2V1000实现了一个抽取率为2、具有线性相位的3阶FIR ...
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畅学e | 发表时间 2015-04-15
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基于子项空间共享技术，利用硬件描述语言编程，在FPGA上对FIR数字滤波器进行了实现。该设计将常系 ...
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晴空万里 | 发表时间 2014-07-31
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大多数数字功能可分为：数据通道、储存器、控制单元、I/O。加法器和乘法器属于数据通道部分。 ...
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一帘幽梦飞 | 发表时间 2014-10-21
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加法器 ： 加法器是为了实现加法的。 即是产生数的和的装置。加数和被加数为输入，和数与进位为输出的装 ...
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lotuse | 发表时间 2016-11-03
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