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[ 文章 ]
利用低抖动LVPECL
扇出缓冲器
增加时钟源的输出数
许多系统都要求具有多个低抖动系统时钟,以便实现混合信号处理和定时。图1所示电路将ADF4351集成锁 ...
by
永不止步步
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发表时间 2014-06-07
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2304次查看
[ 文章 ]
扇出缓冲器
中的附加抖动计算
抖动不仅会降低数据转换器的性能,而且还可在高速数字系统中产生误码。凭直觉判断,给时钟增 ...
by
粽子糖果
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发表时间 2017-05-12
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1807次查看
[ 文章 ]
免费的I/O改进FPGA时钟分配控制
可编程时钟器件集成了主要的时序元件,如一个PLL、分频器、
扇出缓冲器
、零延迟缓冲器,从而节省电路板面 ...
by
微笑眼泪
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发表时间 2015-07-31
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779次查看
[ 文章 ]
测量
扇出缓冲器
中的附加抖动
如果您在通信行业工作,那么您可能很熟悉抖动对系统性能的影响。 ...
by
永不止步步
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发表时间 2014-11-21
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748次查看
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