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时钟速度的提高和更严格的信号时序增加了对精准的高频模块的需求。PLL（锁相环）基于输入信号生成高频输 ...
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倩倩 | 发表时间 2014-07-14
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本文着重介绍Peregrine公司生产的锁相环ＰＥ３２９３的基本原理和典型应用电路，利用该专用集成芯 ...
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永不止步步 | 发表时间 2014-03-21
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本文针对IS-95CDMA手机射频前端频率合成器频率间隔小，分频比大，频率稳定度高等要求，提出了解决 ...
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畅学e | 发表时间 2015-04-23
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跳频频率合成器是跳频收发系统设计的核心，也是技术实现的一个难点。提出一种应用DDS和PLL实现高速跳 ...
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畅学e | 发表时间 2015-05-25
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作为最重要的设计参数之一，选择环路带宽涉及到抖动、相位噪声、锁定时间或杂散之间的平衡 ...
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粽子糖果 | 发表时间 2017-06-05
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跳频频率合成器是跳频收发系统设计的核心，也是技术实现的一个难点。提出一种应用DDS和PLL实现高速跳 ...
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露水非海 | 发表时间 2015-12-16
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假设您已经通过迭代信息传递相位边限和回路频宽在锁相环(PLL)上花了一些时间。遗憾地 ...
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粽子糖果 | 发表时间 2017-05-15
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本文主要在事件驱动思想的基础上提出了对电荷泵锁相环锁定时间进行快速仿真的方法，并且用Matlab语言 ...
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lihong | 发表时间 2015-12-15
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假设您已经通过迭代信息传递相位边限和回路带宽在锁相环（PLL）上花费了一些时间。但遗 ...
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粽子糖果 | 发表时间 2017-05-16
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假设您已经通过迭代信息传递相位边限和回路带宽在锁相环（PLL）上花费了一些时间。但遗憾地是，还是无法 ...
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晓晓nn | 发表时间 2017-03-08
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智能全数字锁相环,在单片FPGA中就可以实现,借助锁相环状态监测电路,通过CPU可以缩短锁相环锁定时 ...
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期待 | 发表时间 2015-03-31
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