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[ 文章 ] 4位除法器vhdl程序

VHDL全名Very-High-Speed Integrated Circuit Hardware ...

by Dabing | 发表时间 2015-02-03 |1894次查看
[ 文章 ] Verilog打造除法器驱动数码管（上）

记得很久以前，用单片机玩数码管的时候，我们用“%”和“/”将一个长长的数字一一分离出来逐个显示在数码 ...

by 永不止步步 | 发表时间 2015-06-11 |1445次查看
[ 文章 ] 一种模拟除法器的设计及仿真验证

模拟除法器是一种能实现两个模拟量相除的电子器件。目前不仅应用于模拟运算方面，而且已扩展到无线通讯、电 ...

by fl | 发表时间 2014-10-30 |1267次查看
[ 文章 ] Verilog打造除法器驱动数码管（下）

上次讲到了如何利用自制的除法器，来驱动数码管的基本方法，这次让他支持负数显示，并让其“动起来”做一个 ...

by 永不止步步 | 发表时间 2015-06-11 |1017次查看