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于芯片开发使用来说，时序图是较为核心也较为重要的一个知识点。在厂家给出的芯片数据手册中，时序图也是非常重要的参数细节。开发者拿到一款芯片时，首先需要做的就是阅读其数据手册，对上面的...
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图中的报错该添加什么库啊，怎么添加呢？这是外部中断的。
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这两天仔细研究了下FAT32，发现里面涉及到了一个大端、小端对齐有点意思，这里也简单总结一下。先在这里说明一下，MSP430是小端对齐的，还有FAT32文件系统中存放字段的顺序也是...
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MSP430(F5529)相比MSP430(F149)来讲，功能更加强大。
UCS简介MSP430F5XX/MSP430F6XX系列器件的UCS包含有五种时钟源，依次是：XT1C...
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本人初学CC2430，虽然不是初学单片机，也不是初次河蟹IDE，更不是初次使用flash programmer。但是在使用的过程中还是遇到了非常多的问题，虽然是一个小问题，但是还是...
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软件环境：windows7旗舰版,IAR V6105(EWARM-EV-WEB-6105) ARM芯片：飞思卡尔K60N512VMD100 （cortex-m4核心）
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在安装msp430仿真器lsd-fet430uif的usb驱动程序时,出现问题，
在inf中找不到所需段落，
解决方法如下：
1.打开widows文件下setupapi....
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察看readme.txt
Project File Listing
/***************************************************...
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IAR生成430烧写方法有2种，
第一种是；将工程的debug模式切换成release模式，看图片操作。
那个.d43文件就...
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1.关于MSP430F4250：
2.关于MSP430F4250 AD：
参考MSP430X4XXFamily User’s Guide:
关于16位AD采样...
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在《都是IO弱上拉惹的祸》文中，提及了Altera的CPLD在初始化时管脚通常会处于弱上拉状态。在实际示波器采样来看，就表现在上电初期IO脚会有一个短暂（当时是持续大约几百us）的...
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昨晚，在用Quartus II对工程进行编译时，遇到了一个错误问题，足足让我想了10秒钟。如果是以前，一两秒就想到。看来是时间太长了，有点忘记了。说不定...
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在ISE14.2中使用IP核，在Core Generator中新建工程，选用Virtex-5的板子，型号为xc5vlx110t-1ff1136，然后找到DSP48 marco，配置...
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第一个问题是，SDRAM上电后默认存储的是什么数据？随机数据吗？通过实验似乎是随机数据，如下图所示
但是在调试的时候发现一个比较有趣的问题是，当电路板掉电后重...
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所需软件：Quartus/ISE、EZ-USB_devtools、Labview与VISA驱动
步骤：
1，安装Quartus/ISE、EZ-USB_devtools、Labv...
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soc中如果让FPGA和HPS同时控制某一个输入或输出会不会出现矛盾？
这是我之前问别人的一个问题。
其实答案很明显，让FPGA和HPS同时控制某一个输入或输出是不可能的事情。...
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最近有个FPGA+DSP架构的项目，安装了DSP的开发环境CCS，这里介绍下CCS的使用方法。说明：开发TMS320C6678，建议使用CCS5.0以上版本，以下介绍基于CCS5....
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一：generateVerilog-2001添加了generate循环，允许产生module和primitive的多个实例化，同时也可以产生多个variable，net，task，...
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选择File->Convert Programming Files...
Programming File Type选择JTAG Indirect Configurat...
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如题,,,再附加上程序的控制说明.......是用GW48教学实验箱仿真的
如果对你有帮助,请大家顶上...
程序直接贴上了
控制说明：
1、电子琴：程序设计采用八个输入端...
畅学电子
