-
应用SDH技术的。。。谁接触过就说说吧
-
题目简述: 两个89C52单片机为对等的关系,其工作模式为分工协作。所谓分工是指两个89C52单片机应能各自控制其管辖的外设(数码管、发光二极管、光敏二极管、小功率直流电机等)...
来自
毕业设计|by
小杰 |发表时间 2014-12-16
|1个回复
-
一、 开题报告的含义与作用 开题报告,就是当课题方向确定之后,课题负责人在调查研究的基础...
来自
毕业设计|by
期待 |发表时间 2015-09-17
|0个回复
-
a模拟地和数字地单点接地
只要是地,最终都要接到一起,然后入大地。如果不接在一起就是"浮地",存在压差,容易积累电荷,造成静电。地是参考0电位,所有电压都是参考地得出的,地的...
-
1、简单描述一个单片机系统的主要组成模块,并说明各模块之间的数据流流向和控制流 流向。简述单片机应用系统的设计原则。(仕兰微面试题目)
2、画出8031与2716...
-
问:
公司之前的一个项目,板子是测试好功能的,然后做为售后库存。
但是最近要出一点那个项目的货,就拿出来再测试 一下功能,结果发现部分板子不能通讯连接了,重新烧录...
-
我们在从事MCU应用开发过程中,难免会碰到MCU芯片异常的问题,其中有些异常比较严重。比如异常复位,表现为复位脚有电平跳变或者干脆处于复位电平;在做代码调试跟踪时,发现代码根本就进...
-
因工作需要,最近在测试FLASH,正好手头有NUC505,便用来进行测试。测试了很多厂家的x25x系列的芯片,GIGADEVICE,WINBOND,EON,AMIC等...
-
74HC161设计异步清零的计数器,想在输出端达到某个值的时候清零,对MRN端应该如何处理呢?
-
题外话:
总感觉“年轻人”在字面上不准确,本人更喜欢用“年青人”
同时又感觉“青年人”的现实处境很诡异,...
-
开发的一款液晶驱动器,接收MCU过来的指令和数据进行图像显示。使用了一片可编程(带使能和PWM调节控制)的背光芯片。在CPLD设计中,上电复位状态将背光使能拉低(关闭),直到MCU...
-
在《都是IO弱上拉惹的祸》文中,提及了Altera的CPLD在初始化时管脚通常会处于弱上拉状态。在实际示波器采样来看,就表现在上电初期IO脚会有一个短暂(当时是持续大约几百us)的...
-
//------------------- //18B20驱动程序 by zmz // 2008.4.19 //-------------------...
-
l 打破流水线可以优化在流水线设计中各级流水用于复制逻辑的面积。
l 当共享逻辑远远大于控制逻辑的时候,则控制可以用于指导逻辑重用。
l 对...
-
近期项目的板卡焊接回来,开始进行硬件调试。在调试FPGA最小电路能否正常工作的时候,出现了这样一个问题:用JTAG烧写器往FPGA中烧写配置文件的时候,文件可以正常烧写,但是FPG...
-
FPGA使用的越来越广泛,除了可用于设计控制电路以为,数字信号处理电路更是FPGA的强项和难点。个人可以说才刚刚入门FPGA设计,也做过一些数字信号处理方面的电路设计,记录下个人心...
-
Xilinx的FPGA设计有一套自己的开发工具——ISE。ISE功能强大,其中最重要一个就是它里面自带了大量的程序模板,使得设计人员不需要自己手动敲一些重复...
-
在ISE14.2中使用IP核,在Core Generator中新建工程,选用Virtex-5的板子,型号为xc5vlx110t-1ff1136,然后找到DSP48 marco,配置...
-
背景:用FPGA扩展5个100M以太网,5片PHY的MDC和MDIO并联在一起,读PHY的ID号错误。
1.电源,时钟都正常,原理图没有复位信号,飞线到FPGA软件复...
-
我用的EPM3128ATC100-10这个芯片,这个芯片输出脚或者输入输出脚默认的上电状态都是高电平,在quartusII里好像不能找到引脚初始状态的设置,我在程序里这样写,感觉方...