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reggen总线时序转RAM时序

时间:07-21 08:55 阅读:902次

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简介：文章内容为reggen总线时序转RAM时序。

op_req_d0 <= op_req;

op_req_d1 <= op_req_d0;

op_ack <= op_req_d1;

ram_we <= 1'b0;

if(op_req == 1'b1) begin

ram_we <= ~wrl_rdh;

ram_wdata <= wrdata;

ram_addr <= address;

end

if(op_req_d1 == 1'b1) begin

rddata <= ram_rdata;

end

标签：

reggen总线时序 RAM时序 FPGA

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