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本文为大家详细介绍一下什么是时钟边沿检测技术。
05-18 16:26by
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在逻辑设计领域，只涉及单个时钟域的设计并不多。尤其对于一些复杂的应用，FPGA往往需要和多个时钟域的信号进行通信。异步时钟域所涉及的两个时钟之间可能存在相位差，也可能没有任何频率关系，即通常所说...
05-18 16:24by
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本文带领大家一起学习什么事异步时钟同步化。
05-18 16:23by
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本文带领大家来了解一下你什么才是真正的任意分频。
05-18 15:33by
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对自己的设计的实现方式越了解，对自己的设计的时序要求越了解，对目标器件的资源分布和结构越了解，对EDA工具执行约束的效果越了解，那么对设计的时序约束目标就会越清晰，相应地，设计的时序收敛过程就会更可...
05-18 15:02by
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讲过了独立按键检测，理所当然应该讲讲FPGA中矩阵键盘的应用了。这个思维和电路在FPGA中有所不同，在此，在此做详细解释，Bingo用自己设计的成熟的代码作为案例，希望对你有用。
05-18 14:59by
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简单的说，进入了电子，不管是学纯模拟，还是学单片机，DSP、ARM等处理器，或者是我们的FPGA，一般没有不用到按键的地方。按键：人机交互控制，主要用于对系统的控制，信号的释放等。因此在这里，FP...
05-18 14:58by
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这几天复习了一下Verilog的语法知识，就借此写写我对这些东西的想法吧。感觉呢，是和C语言差不多，具有C语言基础的朋友学起来应该没什么问题，和C语言相同的地方就不说了吧，重点说一下不同点吧。
05-18 14:47by
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这几天复习了一下Verilog的语法知识，就借此写写我对这些东西的想法吧。感觉呢，是和C语言差不多，具有C语言基础的朋友学起来应该没什么问题，和C语言相同的地方就不说了吧，重点说一下不同点吧。
05-18 14:30by
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本文挑了几个有难度的习题为大家讲解一下。
05-18 14:25by
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关于状态机呢，想必大家应该都接触过，通俗的讲就是数电里我们学的状态转换图。状态机分为两中类型，一种叫Mealy型，一种叫Moore型。前者就是说时序逻辑的输出不仅取决于当前的状态，还取决于输入，而后...
05-18 14:18by
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上次看了一下关于乘法器的Verilog代码，有几个地方一直很迷惑，相信很多初学者看这段代码一定跟我当初一样，看得一头雾水，在网上也有一些网友提问，说这段代码不好理解，今天小墨同学就和大家一起来看一下...
05-18 14:13by
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以前在学单片机的时候，觉得串口通信其实很简单，只要一个指令数据就能轻易的接收或者发送。前几天试着用FPGA实现，发现里面的学问还不少，并没有想象的那么简单。当然代码肯定是参考别人的，不过我还是认真研...
05-18 14:04by
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相信学过单片机的同学对I2C总线都不陌生吧，今天我们来学习怎么用verilog语言来实现它，并在FPGA学习版上显示。
05-18 14:00by
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今天要写的是一段基于FIFO的串口发送机设计，之前也写过串口发送的电路，这次写的与上次的有几分类似。这段代码也是我看过别人写过的之后，消化一下再根据自己的理解写出来的，下面是我写这段代码的全部流程和...
05-18 13:57by
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作为管理员经常要给这些菜鸟们普及基础知识，但是非常不幸的是很多菜鸟怀着一种浮躁的心态来学习 FPGA，总是急于求成。再加上国内大量有关FPGA的垃圾教材的误导，所以很多菜鸟始终无法入门。为什么大量的...
05-18 13:53by
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本文为大家介绍了笔记本电脑上的VGA接口。
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本文带领学习的是精简指令集RISC_CPU设计。
05-18 13:40by
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