本文设计了一种基于0.13微米CMOS工艺的FPGA芯片中的嵌入式存储器模块。该容量为18Kb的同步双端口存储模块，可以配置成为只读存储器或静态随机存储器，每个端口有6种数据宽度、3种写操作模式可供选择。采用行为级与晶体管级协同仿真的方法，同时完成模块的功能验证和时序参数的提取。全定制的核心版图经过自动布局布线工具的包装，最终产生适用于特定FPGA芯片的完整版图。
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