介绍了一种高速实时数据采集系统的设计。该系统以FPGA作为逻辑控制的核心，以USB2.0作为与上位机数据传输的接口，能同时支持单端16路和差分8路模拟信号输入，最大采样率为200 kHz,12位的转换精度。描述了系统的主要组成和FPGA模块化设计的实现方法，并给出了其核心模块的时序仿真波形图。
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第10讲：FPGA设计常用IP核-锁相环
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