介绍了3DES 数据加密算法（DDA）的原理，针对利用FPGA 硬件实现3DES 算法，给出了一种可进化IP 核的具体设计思想，采用可重构电路节省器件内部资源，并采用有限状态机设计技术从而实现数据高速安全传输。本设计是在ALTERA 公司的Quartus II 环境下实现的，并成功下载到支持电路部分重构的Xilinx Virtex II 系列器件中的XC2V1500 芯片中。
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第10讲：FPGA设计常用IP核-锁相环
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