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1、与全局时钟资源相关的原语常用的与全局时钟资源相关的Xilinx器件原语 2、全局时钟资源的使用方 ...
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lotuse | 发表时间 2016-09-23
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基于Cadence Spectre设计仿真平台和TSMCO．18μm CMOS混合信号工艺，对模拟射 ...
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露水非海 | 发表时间 2015-12-18
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当今复杂的FPGA含有众多用于实现各种电路与系统的功能块，诸如逻辑阵列、存储器、DSP 模块、处理器 ...
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露水非海 | 发表时间 2016-05-07
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本文主要介绍的是RC时钟信号产生电路 ...
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hcay | 发表时间 2015-02-15
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提出一种基于FPGA的动态相位调整实现方案。在高速数据传输接口中，由于数据窗缩小以及传输路径不一致， ...
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独狼 | 发表时间 2016-04-29
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PCI总线是一种不依附于某个具体处理器的局部总线。从结构上看，PCI是在CPU和原来的系统总线之间插 ...
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hcay | 发表时间 2014-11-01
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LCD的接口时序波形如图所示。VSYNC是场同步信号，低电平有效，从时序图可以看出，VSYNC是 ...
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lotuse | 发表时间 2016-09-26
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RF电路板设计最重要的是不该有信号的地方要隔离信号，而该有信号的地方一定要获得信号。这就要求我们有意 ...
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永不止步步 | 发表时间 2014-08-14
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随着计算机技术、网络通信技术的进步，组建分布式网络化测试系统，提高测试效率、共享信息资源，已成为现代 ...
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Dabing | 发表时间 2015-01-31
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用于提供测量血压时的时间和日期，以便于以后进行查询使用。方便于使用者对自己一段时间的血压有个清晰的记 ...
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永不止步步 | 发表时间 2014-08-20
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说到异步时钟域的信号处理，想必是一个FPGA设计中很关键的技术，也是令很多工程师对FPGA望而却步的 ...
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永不止步步 | 发表时间 2015-03-06
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本文根据2.5Gbps高速串行收发器的工作实际，为降低后续电路设计难度，采用工作速率较高的电流模式逻 ...
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永不止步步 | 发表时间 2014-10-10
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本文章是关于ADC/DAC设计经典问答，涵盖时钟占空比、共模电压、增益误差、微分相位误差、互调失真等 ...
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lotuse | 发表时间 2016-08-25
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本文章是关于ADC/DAC设计经典问答，涵盖时钟占空比、共模电压、增益误差、微分相 ...
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粽子糖果 | 发表时间 2017-06-05
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I2C 工作速率有100K和400K两种；
支持多机通讯；
支持多主控模块 ...
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郭秀斌 | 发表时间 2014-05-21
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· 高速数字电路（即高时钟频率及快速边沿）的设计成为主流。
· 产品小型化及高性能必须面对在同一块 ...
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凯瑞 | 发表时间 2015-04-16
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本文在CycloneⅢFPGA中实现异步FIFO和锁相环(PLL)结构的设计，避免复杂的时钟管理，简 ...
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YYJ | 发表时间 2015-05-15
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网络服务供应商正以令人瞩目的速度扩充其传输网络容量，来满足对带宽敏感的视频和网络多媒体应用的快速增长 ...
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一帘幽梦飞 | 发表时间 2014-09-28
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文主要详解为什么时钟都用32.768K的晶振以及常用的32.768K晶振有哪些，具体的跟随小编一起来 ...
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晓晓nn | 发表时间 2018-07-27
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用单片机(AT89S52)实现多功能数字钟，该数字钟实现时钟运行，调整，倒计时，秒表功能，且精确度经 ...
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期待 | 发表时间 2015-10-20
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