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本文分析了晶振的漂移对GPS 接收机的影响，从锁相环理论的角度，重点分析了采样时钟抖动对基带 ...
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YYJ|上传于 2015-05-09
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本文主要讨论采样时钟抖动对ADC 信噪比性能的影响以及低抖动采样时钟电路的设计。
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YYJ|上传于 2015-05-09
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提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的 ...
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YYJ|上传于 2015-05-09
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对在高速光时分复用系统中（2 X 10 GHZ）基于铌酸锂（LiNbO₃）调制器的注入光电混合振荡器 ...
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宝啦宝呀|上传于 2015-05-07
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《高速电路设计实践》从设计实践角度出发，介绍了在从事高速电路设计的工作中需要掌握的各项技术及技能，并 ...
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畅学电子|上传于 2015-05-20
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抖动有几种不同的类型和测量方法，以及相应的规格指标，但大多数硬件设计人员没有时间去研究这些，因为对于 ...
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为实现高信噪比(SNR)，ADC的孔径抖动必须很低(参见参考文献1、2和3)。目前可提供孔径抖动低至 ...
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ayang|上传于 2015-06-24
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倍频后的时钟作为采样时钟提供给模数转换器(ADC)，倍频带来的时钟抖动会限制输出信噪比的提高。为了尽 ...
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ayang|上传于 2015-06-24
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（TI资料 - TI技术文档）时钟抖动时域分析 第3部分 ...
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畅学电子|上传于 2014-05-19
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（TI资料 - TI技术文档）我们建立了一个试验，目的是检查测得时钟相位噪声与提取自 ADC 测得 ...
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畅学电子|上传于 2014-05-19
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