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[ 资料 ] FPGA时钟设计.pdf

在设计PLD/FPGA时通常采用几种时钟类型。时钟可分为如下四种类型：全局时钟、门控时钟、多级逻辑时 ...

by 微笑眼泪|上传于 2015-08-21 |162次下载
[ 资料 ] FPGACPLD数字电路原理解析.doc

当产生门控时钟的组合逻辑超过一级时，证设计项目的可靠性变得很困难。即使样机或仿真结果没有显示出静态险 ...

by BruceLee|上传于 2015-07-23 |162次下载
[ 资料 ] 基于门控时钟的寄存器传输级功耗优化.pdf

随着深亚微米技术的发展，功耗已经成为现代超大规模集成电路设计中的一个主要设计约束.本文在设计多点控制 ...

by 谷宗卿|上传于 2015-06-26 |162次下载
[ 资料 ] VerilogHDL综合性设计

VerilogHDL 综合性设计 1 时钟安排选用上升沿触发的单时钟信号,尽量不使用混合触发的 ...

by 期待|上传于 2015-05-13 |162次下载