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一、接口信号描述二、握手机制只有当VALID和READY同时为高时，才能进行传输。 VALID和READY信号的先后顺序有一下三种形式： 2.1...

来自 STM32|by 粽子糖果 |发表时间 2016-09-24 |0个回复

随着FPGA设计复杂程度越来越高，芯片内部逻辑分析功能显得越来越重要。硬件层次上的逻辑分析仪价格十分昂贵，而且操作比较复杂。目前，FPGA芯片的两大供应商都为自己的FPGA芯片提供...

来自 FPGA讨论组|by 永不止步步 |发表时间 2017-03-18 |0个回复

ISE verilog 综合错误提示：ERROR:Xst:880 - "Johnson_source.v" line 45: Cannot mix blocking and non...

来自 FPGA讨论组|by 永不止步步 |发表时间 2017-03-18 |0个回复

背景：xilinx公司的FPGA ，ISE 13.4 开发环境， verilog HDL语言问题描述：检查语法没有错误，用modelsim仿真也可以，但...

来自 FPGA讨论组|by 永不止步步 |发表时间 2017-03-18 |0个回复

　　本设计选用具有高集成度、低功耗、短开发周期的FPGA来完成此项设计，以实现系统的ASIC为研究背景，具有很强的现实意义和广阔的市场空间。采用xilinx公司Spartan 3...

来自消费电子|by 一见钟情 |发表时间 2017-08-08 |0个回复

可以根椐以下的知识选择使用的软件.基于实际经验与实际项目详细理解并掌握成为合格的硬件工程师的最基本知识。1）基本设计规范2） CPU基本知识、架构、性能及选型指导3） MOTOR...

来自电子工程师常用软件|by 电子微观世界 |发表时间 2015-01-20 |2个回复

FPGA/CPLD能做什么呢？可以毫不夸张的讲，FPGA/CPLD能完成任何数字器件的功能，上至高性能CPU,下至简单的74电路，都可以用FPGA/CPLD来实现。 FPGA...

来自 FPGA|by 银火虫 |发表时间 2016-06-17 |0个回复

本设计选用具有高集成度、低功耗、短开发周期的FPGA来完成此项设计，以实现系统的ASIC为研究背景，具有很强的现实意义和广阔的...

来自电路分析|by 粽子糖果 |发表时间 2017-01-23 |0个回复