主要步骤:1.建立工程new->New project Wizard2.输入verilog文件new->verilog hdl file
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永不止步步 |发表时间 2017-03-23
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操作系统: WinXP 32bit
仿真器: SEED-XDS560 Plus
开发环境: CCS 5.2
目标处理器: TMS320 C6727
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一见钟情 |发表时间 2017-09-21
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都是些在项目中的小感想,开个头,慢慢补充:
1.千万不要假设别人提交给你的数据是合法的,不管是网络传输还是函数调用,自己的模块应该具有足够的免疫力。
2.尽量减少和别的模块的耦...
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