为得到性能优良、符合实际工程的锁相环频率合成器,提出了一种以ADI的仿真工具ADIsimPLL为基础,运用ADS(Advanced Design System 2009)软件的快速设计方法。采用此方法设计了频率输出为930~960 MHz的频率合成器。结果表明该频率合成器的锁定时间、相位噪声以及相位裕度等指标均达到了设计目标。
第10讲:FPGA设计常用IP核-锁相环
第10讲:FPGA设计常用IP核-锁相环--华清远见
一周搞定系列之模电_第12讲_模电实际电路设计
一周搞定系列之数电_第6讲_数电电路设计
国家级精品课程-浙江大学电子技术基础01
国家级精品课程-浙江大学电子技术基础04-05
国家级精品课程-浙江大学电子技术基础12-13
国家级精品课程-浙江大学电子技术基础10-11
Cocktail
x