本文介绍了基于FPGA/CPLD的嵌入式VGA显示系统的设计，详细讨论了用VHDL设计行场扫描时序的方法，这种设计方法稍作改动便可产生任意行场扫描时序，具有很好的移植性。该显示系统已成功地在雷达图形显示系统中使用，且显示器的分辨率达到了1280*1024，刷新频率为60 Hz。
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