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本文介绍的是EDA中的电梯控制器的主要VHDL源程序 ...
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畅学e | 发表时间 2015-05-13
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数据流建模意味着根据数据在寄存器之间的流动和处理过程对电路进行描述，而不是直接对电路的逻辑门进行实 ...
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lotuse | 发表时间 2016-09-08
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摘要：介绍了基于FPGA的图形式LCD&VGA控制器的设计,详细讨论了用VHDL设计行场扫描时序的方 ...
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期待 | 发表时间 2015-05-26
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随着电子技术和ASIC技术的发展.数字系统设计向速度快、容量大、体积小、重量轻的趋势发展。目前数字系 ...
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倩倩 | 发表时间 2014-06-23
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为了方便地使用DRAM，降低系统成本，本文提出一种新颖的解决方案：利用80C186XL的时序特征，采 ...
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Dabing | 发表时间 2015-02-15
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HDL是Hardware Description Language的缩写，正式中文名称是“硬件描述语 ...
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Dabing | 发表时间 2015-01-29
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Verilog HDL是一种硬件描述语言（HDL:Hardware Discription Lang ...
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lihong | 发表时间 2016-01-11
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上一节介绍了HDL设计文件的实现，实现完HDL以后就可以完成你的Vivado设计，并可以产生比特流了 ...
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期待 | 发表时间 2015-04-09
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近几年嵌入式Internet开始迅猛发展，但绝大多数嵌入式Internet都使用微控制器和相应的软件 ...
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永不止步步 | 发表时间 2014-06-25
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本文充分利用了VxWorks 的实时性和MPC860T SCC通道提供的高速HDLC串口接入功能，实 ...
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宝啦宝呀 | 发表时间 2015-06-17
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Verilog HDL是一种硬件描述语言（HDL:Hardware Description Lang ...
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Dabing | 发表时间 2015-02-04
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循环冗余码校验（CRC）是一种可靠性很高的串行数据校验方法。介绍循环冗余码校验的基本原理，并分别用单 ...
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Dabing | 发表时间 2015-02-03
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在高速实时或者非实时信号处理系统当中,使用大容量存储器实现数据缓存是一个必不可少的环节,也是系统实现 ...
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王者风范 | 发表时间 2015-11-16
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想出了一个半整数分频的VHDL语言描述.其实很多问题只要你耐心，也是比较容易的
写出来与大家共 ...
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VHDL与VERILOG两种语言各自的优点 ...
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A123 | 发表时间 2015-04-21
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为实现对水声信号的多通道同步采集并存储，提出了一种基于FPGA的多通道信号同步采集、高速大容量实时存 ...
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露水非海 | 发表时间 2015-12-08
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典型例子：用Verilog HDL实现一个锁存器，当输入数据大于127时，将输入数据输出，否则输出0 ...
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期待 | 发表时间 2015-09-24
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本文利用VHDL语言在CPLD上实现了串行通信，完全可以脱离单片机使用，克服了单片机的许多缺点。 ...
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Dabing | 发表时间 2015-02-07
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本系统以AD7892SQ和CPLD(复杂可编程逻辑器件)为核心设计了一个多路信号采集电路，包括模拟多 ...
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Dabing | 发表时间 2015-02-07
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基于VHDL的嵌入式DS1820控制器，具有转换速度快、精度高、通用性好等优点。同时，嵌入软核的F ...
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Dabing | 发表时间 2015-02-14
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