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笔者利用VIDL硬件描述语言和原理图输入方式，通过MAX+plusII开发软件和ALTERA公司的F ...
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永不止步步 | 发表时间 2014-06-27
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滤波器的功能就是允许某一部分频率的信号顺利的通过，而另外一部分频率的信号则受到较大的抑制，它实质上是 ...
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该文在EDA 开发平台上，利用VHDL 语言设计数控分频器电路，采用可编程逻辑器件CPLD/FPGA ...
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hcay | 发表时间 2014-11-01
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本文对高性能应用的FPGA设计中的电源噪声情况进行了说明，并由此指出FPGA设计对时钟源的特殊要求， ...
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hcay | 发表时间 2014-10-20
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该文在EDA 开发平台上，利用VHDL 语言设计数控分频器电路，采用可编程逻辑器件CPLD/FPGA ...
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hcay | 发表时间 2014-11-01
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给出了一种收发分频双线极化层叠型微带贴片天线的设计方法，利用双层贴片谐振于不同的频率来实现双频，通过 ...
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露水非海 | 发表时间 2015-12-29
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定时器0 的PWM功能，通过上边对定时器的了解下边也会很简单的掌握。选择相位修正模式，WGM00=1 ...
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期待 | 发表时间 2015-04-11
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1.Verilog语言及其于硬件电路之间的关系。
2.器件结构（最好熟练掌握Spartan3，Ve ...
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晴空万里 | 发表时间 2014-07-26
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ARM中定时器浅谈
LPC21XX/22XX含有两个32位定时器：定时器0和定时器1。这两个定 ...
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晴空万里 | 发表时间 2014-07-29
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单片UHF ASK发射器，采用SOP（M）-8封装，芯片内包含有：由基准振荡器、相位检波器、分频器、 ...
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hcay | 发表时间 2014-11-24
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介绍了一种用单片机控制的智能微波信号源发生器，以美国国家半导体公司的低功率、高性能的δ-Σ小数分频数 ...
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畅学e | 发表时间 2015-04-29
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Lte的框架结构分为分频多任务(FDD)及分时多任务(TDD)两种迥然不同的运作模式，两者的底层特 ...
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hcay | 发表时间 2015-02-13
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首先分析了应用于倍频电路的预置可逆分频器的工作原理，推导了触发器的驱动函数。并建立了基于simuli ...
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畅学e | 发表时间 2015-04-27
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此次笔记记录的是 FPGA 片内时钟管理单元 PLL,该单元可以实现系统时钟的分频、 倍频，是 FP ...
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独狼 | 发表时间 2016-04-18
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本文章是关于FPGA之任意等分频和倍频。 ...
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独狼 | 发表时间 2016-04-29
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本文利用FPGA完成了8路同步话音及16路异步数据的复接与分接过程,并且实现了复接前的帧同步捕获和利 ...
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期待 | 发表时间 2015-05-25
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现今的FPGA设计大多采用时序逻辑，需要时钟网络才能工作，通常情况下，时钟通过外部晶体振荡器产生。虽 ...
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这是数据线对数据线、地址线对地址线的标准连接方式，如图2.2所示。由于ADC0809片内没有时钟 ...
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长长11 | 发表时间 2020-03-23
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针对谐波污染问题，设计并实现了一种由上、下位机组成的并联型有源电力滤波器。以TMS320C5416 ...
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倩倩 | 发表时间 2014-06-23
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STM32中有一个全速功能的USB模块，其串行接口引擎需要一个频率为48MHz的时钟源。该时钟源只能 ...
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粽子糖果 | 发表时间 2016-12-03
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