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[ 话题 ]
FPGA的跨时钟域信号处理
图1是一个跨时钟域的异步通信实例,发送域和接收域的时钟分别是clk_a和clk_b。这两个时钟频率不同,并且存在一定的相位差。对于接收时钟域而言,来自发送时钟域的信号data_a2...
来自
51讨论交流
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by
粽子糖果
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发表时间 2016-10-14
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[ 话题 ]
教你什么才是真正的任意分频
一、为啥要说任意分频 也许FPGA中的第一个实验应该是分频实验,而不是流水灯,或者LCD1602的"Hello World"显示,因为分频的思想在FPGA中极为重...
来自
51讨论交流
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by
粽子糖果
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发表时间 2016-10-14
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0个回复
[ 话题 ]
用雕刻机雕刻PCB全过程
将近一个月前买了台旗开得胜雕刻机,买来目的是想拿来做PCB电路板,用了多年的万能板,现在想改用下PCB,万能板即浪费焊锡也不能做出的电路精细的电路,用PCB板就不同了,用CAD制作...
来自
创意DIY
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by
永不止步步
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发表时间 2016-10-28
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[ 话题 ]
串口通信试验中的一个新手问题
if(clk_bps) begin &...
来自
FPGA讨论组
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by
永不止步步
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发表时间 2013-12-31
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[ 话题 ]
开发工程师的FPGA学习心得
从大学时代第一次接触FPGA至今已有10多年的时间,至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言,设计都...
来自
FPGA
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by
一见钟情
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发表时间 2016-10-17
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[ 话题 ]
FPGA开发经验工程师谈设计技巧
我们先谈一下FPGA基本知识: 1、硬件设计基本原则 FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在PAL、GAL、CPLD...
来自
FPGA
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by
粽子糖果
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发表时间 2016-11-09
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0个回复
[ 话题 ]
FPGA & Verilog开发经验
1. wire与reg之外的数据类型不要在verilo
G代码
中出现。 2. assign(组合逻辑)与always之外的语句不要在verilo
G代码
中出现。 3. 一个modu...
来自
FPGA
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by
粽子糖果
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发表时间 2017-09-08
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