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[ 话题 ] this signal is connected to multiple drivers

背景：Xilinx公司的FPGA ，ISE 13.4 开发环境， verilog HDL语言问题描述：检查语法没有错误，用Modelsim仿真也可以，但...

来自 FPGA讨论组|by 永不止步步 |发表时间 2017-03-18 |0个回复
[ 话题 ] Modelsim仿真ROM的注意点

mif文件是用来给Quautus综合网表用的，而hex可以被用来作为Modelsim仿真的数据输入用。换句话说modelisim对mif文件不支持，而只对hex文件支持。用mo...

来自仿真|by 永不止步步 |发表时间 2015-07-18 |0个回复
[ 话题 ] Modelsim仿真遇到的问题

今天直接用modelsim建立工程仿真某个verilog文件，比较特殊的地方是，dcfifo属于原语调用的方式，如下图当用quartus调用modelsim...

来自仿真|by 永不止步步 |发表时间 2017-02-18 |0个回复
[ 话题 ] Quartus II 版本问题解决方案

问题1：在做一个项目时，发现该项目（主要才用原理图设计）可以在Quartus 9.0版本上编辑，但是无法编译通过，表现在会提示一个弹窗的错误，选择no可以继续进行，...

来自 EDA学习交流|by 永不止步步 |发表时间 2017-04-21 |0个回复