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[ 话题 ] FPGA设计宝典之提高算法速度的六大绝招

“面积”：指一个设计所消耗的FPGA的逻辑资源数量。FPGA中的逻辑资源,也就是触发器( FF)和查找表(LUT) 。 “速度”：...

来自 FPGA|by 一见钟情 |发表时间 2016-09-09 |0个回复

[ 话题 ] 一文了解FPGA与DSP的区别、特点及用途

FPGA是一种可编程的硅芯片，DSP是数字信号处理，当系统设计人员在项目的架构设计阶段就面临到底采用FPGA还是DSP的重要问题。本文将首先分别介绍FPGA和DSP的特点，然后再从...

来自 FPGA|by 一见钟情 |发表时间 2016-09-09 |0个回复

[ 话题 ] 所见即所得之逻辑单元端口取反结构实例分析

根据前面博文对所见即所得的简单展示，使得我们了解到了ALTERA器件逻辑单元某些输入端口确实包含了这种自动可编程取反的硬件结构。这里我将给出一个具体实例来为大家展示这种特性。 ...

来自 FPGA|by 一见钟情 |发表时间 2016-09-10 |0个回复

[ 话题 ] FPGA设计小Tips：如何正确使用FPGA的时钟资源

相位匹配时钟分频器设计人员可使用相位匹配时钟分频器(PMCD)来生成相位匹配的分频输入时钟信号。这与分频时钟的DCM频率综合相似。PMCD还能生成设计中相位匹配但有延迟的时钟信...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-12 |0个回复

[ 话题 ] 所见即所得之逻辑单元端口取反结构实例分析

根据前面博文对所见即所得的简单展示，使得我们了解到了ALTERA器件逻辑单元某些输入端口确实包含了这种自动可编程取反的硬件结构。这里我将给出一个具体实例来为大家展示这种特性。 ...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-13 |0个回复

[ 话题 ] FPGA牛人给FPGA初学者入门留下的几点心得体会

我起初的FPGA学习历程，走了不少弯路，现在看来，如果采用自学的方式，这些弯路也是多数人会遇到的： 1.买一本书，花大量的时间学习语法； 2.到网上到处搜一些资料，类似...

来自 FPGA|by 一见钟情 |发表时间 2016-09-18 |0个回复

[ 话题 ] FPGA平台实现最小开关损耗的SVPWM算法

引言脉冲调制技术（PWM）已被广泛应用于逆变器的设计当中，电压空间矢量调制技术(SVPWM)与SPWM相比，直流电压利用率提高了（15.4%），且利于数字化实现［19］。本文介...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-19 |0个回复

[ 话题 ] 例说FPGA之FPGA与其它主流芯片的比较

FPGA、ASiC和ASSP 抛开FPGA不提，大家一定都很熟悉ASiC与ASSP。所谓ASiC，即专用集成电路（Application Specific integrated ...

来自 FPGA|by 一见钟情 |发表时间 2016-09-20 |0个回复

[ 话题 ] 如何学习FPGA？FPGA学习必备基础知识

(一) 要了解什么是FPGA 既然要玩转FPGA，那我们首先最重要的当然是要了解什么FPGA。FPGA(Field-Programmable Gate Array)，即现场可编程...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-21 |0个回复

[ 话题 ] 在Quartus ii中调用Modelsim联合仿真

一．在quartus中新建工程后，点击工具栏里的Tools，在下拉菜单中选取Options，弹出对话框，在对话框里选择EDA Tool Options，然后在右侧的Modelsim...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-21 |0个回复

[ 话题 ] FPGA学习需注意的几个重要问题

1.基础问题 FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。在语言方...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-22 |0个回复

[ 话题 ] 再说ModelSim难以察觉的问题

为什么，是“再说”，因为前面写的有篇博客叫ModelSim难以察觉的问题废话少说，进入正题：前些天仿真PLL时，发现PLL没有时钟输出，但是示波器一...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-22 |0个回复

[ 话题 ] 完善FPGA系统设计的三个原则

一，面积与速度的平衡互换原则这里的面积指的是FPGA的芯片资源，包括逻辑资源和i/O资源等；这里的速度指的是FPGA工作的最高频率（和DSP或者ARM不同，FPGA设计的工作频...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-23 |0个回复

[ 话题 ] FPGA学习经验的总结：AXi4协议

一、特点单向通道体系结构：信息流只以单方向传输，简化时钟域间的桥接，减少门数量。当信号经过复杂的片上系统时，减少延时。支持多项数据交换：通过并行执行猝发操作，极大地提高了数...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-26 |0个回复

[ 话题 ] 关于cic滤波器的FPGA实现

一、关于多采样率数字滤波器很明显从字面意思上可以理解，多采样率嘛，就是有多个采样率呗。前面所说的FiR，iiR滤波器都是只有一个采样频率，是固定不变的采样率，然而有些情况下需要...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-27 |0个回复

[ 话题 ] PCB上FPGA的同步开关噪声分析

系统级SSO的形成机制带FPGA的PCB是一个复杂的系统，可将其分为包含有源电路的晶片部分、带有嵌入式无源器件的支撑走线的封装部分，和为FPGA与外部提供连接的电路板部分。在此...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-28 |0个回复

[ 话题 ] 如何克服FPGA电路板设计挑战

选取一家供应商你面临的第一个问题当然是供应商和器件的选择。通常供应商决策倾向于你以前接触最多的那家——如果你是一位FPGA初学者当然另当别论了。或许这个...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-28 |0个回复

[ 话题 ] quartus与Modelsim 联合仿真时自动退出

quartus ii 11与Modelsim 6.6d联合仿真时，每次一点仿真进入Modelsim 都提示"no design loaded",...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-29 |1个回复

[ 话题 ] quartus ii 时序仿真出现了问题

两个输入管脚分别输入了一个时钟信号，而且两个信号是反相的。输出之后应该是输出端s位高电平，co为低电平才对的，但是输出出现了一些峰刺还是什么的。用功能仿真就没有这个问题。请大家帮忙...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-29 |1个回复

[ 话题 ] 一个变量只能在一个always中赋值

对按键计数，编译不通过！！module dc_counter(rstn,up,down,dout);input ...

来自 FPGA|by 粽子糖果 |发表时间 2016-09-30 |1个回复