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任务、函数的定义和调用都包括在一个module的内部，他们一般用于行为级建模，在编写Testbench时用的较多，而在写可综合的代码时要少用。
function的定义：
fun...
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自动生成Tcl文件
Project -> Generate Tcl File for Project...
弹出如下对话框，设置脚本路径。
...
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一 背景
最近在拿FPGA测试ISA总线的时序，同时ISA总线的master是用研华工控机pcm3362。工控机跑的UBUNTU系统，所以总体是在测试Linux环境下，驱动程序通...
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如题,,,再附加上程序的控制说明.......是用GW48教学实验箱仿真的
如果对你有帮助,请大家顶上...
程序直接贴上了
控制说明：
1、电子琴：程序设计采用八个输入端...
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任务就是一段封装在“task-endtask”之间的程序。任务是通过调用来执行的，而且只有在调用时才执行，如果定义了任务，但是在整个过程中都没有调用它，那么...
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可以根椐以下的知识选择使用的软件.基于实际经验与实际项目详细理解并掌握成为合格的硬件工程师的最基本知识。1） 基本设计规范2） CPU基本知识、架构、性能及选型指导3） MOTOR...
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0 引言
Altera公司开发的Nios II是基于可编程片上系统SOPC(System on a Programmable Chip)技术的32 位嵌入式处理器软核。Alter...
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光立方实验进度。。。
失败之1：焊接光立方，间隔老是控制不好。想了个办法，弄个铁丝先做支架然后再焊接。。。
结果发现铁丝跟LED引脚焊不上，查了下资料才发现，电烙铁焊铁丝就是焊...
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verilog 與 C 語言的運算子大同小異，例如：C = A + B ; A = A + 1;
但是在加法中
verilog
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1.硬件设计基本原则
1)速度与面积平衡和互换原则：一个设计如果时序余量较大，所能跑的频率远高于设计要求，能可以通过模块复用来减少整个设计消耗的芯片面积，这就是用速度优势换面...
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CPLD按英语说是复杂可编程逻辑器件，对于一个硬件工程师来说，能应用cpld技术是一个十分强大的能力。它的应用可在根本上解决许...
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Protel
PROTEL是Altium公司在80年代末推出的EDA软件，在电子行业的CAD软件中，它当之无愧地排在众多EDA软件的前面，是电子设计者的首选软件，它较早就在国内开...
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如何使用Libero IDE编写verilog模块，并验证语法错误，最后综合，然后查看综合后的电路？
1.打开Libero集成开发环境，建立新工程，具体不说了。
2...
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在做PCIE ip core仿真时，安装的modelsim se 10.0a在编译xilinx的unisims 一直提示can't determine language ...
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永不止步步 |发表时间 2016-11-10
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今天直接用modelsim建立工程仿真某个verilog文件，比较特殊的地方是，dcfifo属于原语调用的方式，如下图
当用quartus调用modelsim...
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永不止步步 |发表时间 2017-02-18
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主要步骤：1.建立工程new->New project Wizard2.输入
verilog文件new->
verilog hdl file
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永不止步步 |发表时间 2017-03-23
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汉王笔试 下面是一些基本的数字电路知识问题，请简要回答之。a) 什么是Setup 和Holdup时间？
Setup/hold time是测试芯片对输入信号和时钟信号之间的时间要求...
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1. FPGA概述
FPGA是英文Field Programmable Gate Array的缩写，即现场可编程门阵列，它是在PAL、GAL、EPLD等可编程器件的基础上进一步发...
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银火虫 |发表时间 2016-05-28
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这里我谈谈我的一些经验和大家分享，希望能对IC设计的新手有一定的帮助，能使得他们能少走一些弯路，欢迎讨论!
我相信“如果有梦想，就会实现!"
在IC工业中有许多不同...
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银火虫 |发表时间 2016-06-03
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1.基础问题
FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。 在语言方...
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银火虫 |发表时间 2016-06-06
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