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锁相的意义是相位同步的自动控制，能够完成两个电信号相位同步的自动控制闭环系统叫做锁相环，简称PLL。 ...
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期待 | 发表时间 2015-04-22
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给出了一个符合DVI1.0规范的基于FPGA的视频接收器的实现方法,该方法利用FPGA内置的PLL ...
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倩倩 | 发表时间 2014-06-21
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最新三段单片无线收发芯片nRF903是集成了高频发射、高频接收、PLL合成、GMSK调制、GMSK解 ...
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期待 | 发表时间 2015-05-05
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压控振荡器(以下简称VCO)已经成为当今无线收发器系统中不可缺少的模块, 它是锁相环中最重要的blo ...
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许多系统都要求具有多个低抖动系统时钟，以便实现混合信号处理和定时。图1所示电路将ADF4351集成锁 ...
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永不止步步 | 发表时间 2014-06-07
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——时钟控制(RCC)
三种不同的时钟源可用作系统时钟（SYSCLOCK）：
HIS振荡器时钟 ...
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期待 | 发表时间 2015-04-03
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经常有要阻挡某些频率信号的情况，其中最常见的是50Hz或60Hz的电力线工频。图1中的PLL陷波滤波 ...
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倩倩 | 发表时间 2014-06-14
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复位
有三种复位：系统复位、电源复位和后备域复位
时钟
三种不同的时钟源可被用来驱动系统 ...
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期待 | 发表时间 2015-04-02
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跳频频率合成器是跳频收发系统设计的核心，也是技术实现的一个难点。提出一种应用DDS和PLL实现高速跳 ...
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畅学e | 发表时间 2015-05-25
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单从字意上理解，Clock Resources即时钟资源，从广义上来讲，时钟资源不仅包括了文档中重点 ...
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hcay | 发表时间 2014-10-13
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AD9958是美国AD公司采用先进的DDS技术生产的高性能频率合成器，它能产生双通道250 MHz的 ...
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露水非海 | 发表时间 2015-12-25
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分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环（如A ...
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晴空万里 | 发表时间 2014-08-02
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基于FPGA的DDS+DPLL跳频信号源设计 ...
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黑魔 | 发表时间 2014-03-08
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本文设计了一种宽频率范围的CMOS锁相环(PLL)电路，通过提高电荷泵电路的电流镜镜像精度和增加开关 ...
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永不止步步 | 发表时间 2014-06-07
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在无线通信领域中,为了提高频谱利用率，现代通信系统对频率合成器的精度、频率分辨率、转换时间和频谱纯度 ...
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hcay | 发表时间 2015-01-21
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研究了DDS+双PLL构成的新型数字调谐系统:A环产生DDS所需的时钟信号,B环产生高频输出。B环使 ...
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以我自己的实际应用的片子（Xilinx最具性价比的Spartan-3E系列XC3S500E）为例详细 ...
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期待 | 发表时间 2015-04-11
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您曾设计过具有分数频率合成器的锁相环（PLL）吗？这种合成器在整数通道上看起来很棒，但在只稍微偏离这 ...
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使用功率分析仪测量数据时，要选择合适的同步源，如果同步源设定不当，测量值有可能不稳定或出现错误，谐 ...
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小尚 | 发表时间 2015-12-16
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您曾设计过具有分数频率合成器的锁相环（PLL）吗？这种合成器在整数通道上看起来很棒，但 ...
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粽子糖果 | 发表时间 2017-05-12
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