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传统的光纤检测系统大都是基于MCU架构来实现的,虽然MCU系统或DSP处理器在数字信号处理方面功能强大,但难以完成大量实时数据的采集,因采样点少带来的测量误差会累积到测试结果。本设...
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银火虫 |发表时间 2016-05-28
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任何电子器件的使用寿命均取决于其工作温度。在较高温度下器件会加快老化,使用寿命会缩短。但某些应用要求电子产品工作在器件最大额定工作结温下。以石油天然气产业为例来说明这个问题以及解决...
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银火虫 |发表时间 2016-06-03
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这里我谈谈我的一些经验和大家分享,希望能对IC设计的新手有一定的帮助,能使得他们能少走一些弯路,欢迎讨论!
我相信“如果有梦想,就会实现!"
在IC工业中有许多不同...
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银火虫 |发表时间 2016-06-03
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仿人假手作为肢残患者重获人手功能的主要对象,具有重大的社会需求。理想的假手应具有人手的仿生特征,主要体现在假手构造、控制方式与环境感知3个方面,但由于其有限的体积和复杂的传感器系统...
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银火虫 |发表时间 2016-06-06
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摘要:本文介绍了一种基于FPGA的多数值分频器的设计,该分频器可以实现占空比及分频系数可调,其分频数值可以是整数、小数和分数。文章给出了使用Altera公司的Cyelon eII系...
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银火虫 |发表时间 2016-06-08
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在芯片的研发环节,FPGA 验证是其中的重要的组成部分,如何有效的利用 FPGA 的资源,管脚分配也是必须考虑的一个重要问题。一般较好的方法是在综合过程中通过时序的一些约束让对应的...
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银火虫 |发表时间 2016-06-17
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FPGA/CPLD能做什么呢?
可以毫不夸张的讲,FPGA/CPLD能完成任何数字器件的功能,上至高性能CPU,下至简单的74电路,都可以用FPGA/CPLD来实现。
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银火虫 |发表时间 2016-06-17
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1) QuartusII对代码进行时序仿真时出现Error: Can't continue timing simulation because delay annotation i...
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银火虫 |发表时间 2016-06-23
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M9K支持从8192x1一直到256x36的配置,那么如果设计了两个4096x1的RAM,那么会是在同一个M9K里面吗?又或者四个2048x1呢,或者两个2048x2
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成为嵌入式硬件工程师需要学习的内容
第一:掌握硬件总体设计 掌握硬件总体设计所必须具备的硬件设计经验与设计思路 1) 产品需求...
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FPGA这个词可能很多人都有所耳闻,尤其是理工科的同学们大多数应该都自愿或被迫被这个词刷屏过。但要真追究起来FPGA到底是个什么东西。很多非相关专业的人都会陷入一脸迷茫。不过说起开...
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一.在quartus中新建工程后,点击工具栏里的Tools,在下拉菜单中选取Options,弹出对话框,在对话框里选择EDA Tool Options,然后在右侧的Modelsim...
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一、特点
单向通道体系结构:信息流只以单方向传输,简化时钟域间的桥接,减少门数量。当信号经过复杂的片上系统时,减少延时。
支持多项数据交换:通过并行执行猝发操作,极大地提高了数...
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一、关于多采样率数字滤波器
很明显从字面意思上可以理解,多采样率嘛,就是有多个采样率呗。前面所说的FIR,IIR滤波器都是只有一个采样频率,是固定不变的采样率,然而有些情况下需要...
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系统级SSO的形成机制
带FPGA的PCB是一个复杂的系统,可将其分为包含有源电路的晶片部分、带有嵌入式无源器件的支撑走线的封装部分,和为FPGA与外部提供连接的电路板部分。在此...
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两个输入管脚分别输入了一个时钟信号,而且两个信号是反相的。输出之后应该是输出端s位高电平,co为低电平才对的,但是输出出现了一些峰刺还是什么的。用功能仿真就没有这个问题。请大家帮忙...
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为什么我想抓如下用(* MARK_DEBUG="true" *)定义的信号抓不到?reg [7:0] raw_u_gauss[0:505];(* MAR...
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引 言
在图像处理系统中常需要对图像进行预处理。由于图像处理的数据量大,对于实时性要求高的系统,采用软件实现通常难以满足实时性的要求。Altera的QuartusⅡ作为一种可编程...
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系统级SSO的形成机制
带FPGA的PCB是一个复杂的系统,可将其分为包含有源电路的晶片部分、带有嵌入式无源器件的支撑走线的封装部分,和为FPGA与外部提供连接的电路板部分。在此...
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在演算法交易领域的最新进展是导入一些更低延迟的解决方案,其中最佳的方式是使用FPGA搭建的客制硬体。这些FPGA硬体可说是硬编码ASIC的极致性能和CPU的灵活度之间的桥梁,提供大...