STVD中报“ERROR:before starting debug session,please,select a target”错误
Protel
PROTEL是Altium公司在80年代末推出的EDA软件，在电子行业的CAD软件中，它当之无愧地排在众多EDA软件的前面，是电子设计者的首选软件，它较早就在国内开...
如何使用Libero IDE编写VeriLoG模块，并验证语法错误，最后综合，然后查看综合后的电路？
1.打开Libero集成开发环境，建立新工程，具体不说了。
2...
大家知道使用KEIL FOR ARM可以通过两种编译器来进行编译，一种就是比较古老的CARM，另一种就是现在KEIL力推的REALVIEW MDK，现在的版本可能已经到了3.5左右...
#define abc (*(volatile unsigned long *)0xE0200280)
开始对于上面的语法不太理解，但通过拆分，我们可以看的更明...
选择一个正确的名字是编程中最重要的事。以前向大家推荐过两篇文章《编程命名中的7+1个提示》 和《编程中的命名设计那点事》，今天再向大家推荐一篇。一个正确的命名可以让你更容...
如果在程序中出现了error C3646，那么这个错误可能是由多种问题所导致的，这篇文章将对多种错误及对应解决方法进行分析。
在MSDN的官方网站中，Complier Error...
提示没有找到MSVCR80D.dll
R6034
An application has made an attempt to load the C runtime librar...
在做PCIE ip core仿真时，安装的modelsim se 10.0a在编译xilinx的unisims 一直提示can't determine language ...
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永不止步步 |发表时间 2016-11-10
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Pspice现在是集成到Cadence中的一个电路仿真工具，能通过Pspice模型的原理图仿真电路的输出结果。其大致步骤是：
1. 创建仿真工程
执行菜单命令File->...
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永不止步步 |发表时间 2017-02-17
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今天直接用modelsim建立工程仿真某个veriLoG文件，比较特殊的地方是，dcfifo属于原语调用的方式，如下图
当用quartus调用modelsim...
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永不止步步 |发表时间 2017-02-18
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SEED-XDS510仿真器报错：this error was generated by TI's USCIF driver解决办法汇总
使用的合众达510仿真器，安装完仿真器驱...
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永不止步步 |发表时间 2017-03-17
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主要步骤：1.建立工程new->New project Wizard2.输入veri
LoG文件new->veri
LoG hdl file
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永不止步步 |发表时间 2017-03-23
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不知不觉已经出来工作一年，经过一年的工作，使我学了不少东西，从而使我认识到以前很多不足之处，也想把自己的程序调试经验跟大家分享下。
首先是软件的编写环境，选择一个编译平台对于...
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