-
ISP（In-System PrOgrammable;在线编程）。ISP笼统的说就是在线编程,把单片机焊到电路板上,如果发现程序哪里有不合适的地方,可以直接通过pc进行编程,而不用...
-
问题如下：
我用DM642接FLASH芯片Am29LV033C用于BOOT，系统没有用FPGA。因为DM642地址线不够，考虑FLASH高三位地址用DSP的IO来扩，好像只有GP...
-
这段时间去面试了几家公司，发现比较大的公司相对于重视基础问题。这里边又有几个问题特别的突出。他们是：同步时钟设计、亚稳态、异步FIFO。可以说，这些个问题要是弄清楚了，就至少满足了...
-
在使用chipscOpe来查看输入时钟时，如果输入时钟是chipscOpe的采样时钟，那么这个时钟线将显示不了高低变化的电平。因为要看的时钟和采样的时钟同步，采样时钟高，输入时钟高...
-
随着FPGA设计复杂程度越来越高，芯片内部逻辑分析功能显得越来越重要。硬件层次上的逻辑分析仪价格十分昂贵，而且操作比较复杂。目前，FPGA芯片的两大供应商都为自己的FPGA芯片提供...
-
ISE verilOg 综合错误提示：ERROR:Xst:880 - "JOhnsOn_sOurce.v" line 45: CannOt mix blOcking and nOn...
-
背景：Xilinx公司的FPGA ，ISE 13.4 开发环境， verilOg HDL语言
问题描述：检查语法没有错误，用mOdelsim仿真也可以，但...
-
• 信号可以分为端口信号和内部信号。出现在端口列表中的信号是端口信号，其它的信号为内部信号。
• &n...
-
一：generateVerilOg-2001添加了generate循环，允许产生mOdule和primitive的多个实例化，同时也可以产生多个variable，net，task，...
-
(一)Quartus警告解析 1.FOund clOck-sensitive change during activeclOck edge at time<tim...
-
ErrOr: Specified license is nOt valid fOrthis machine
Quartus II 软件没有破解好,重新破解试...
-
mOdule datainput(DVAL,LVAL,FVAL,in,clk_m,Y_data,C_data);
input LV...
-
NIOS II 运行应用程序Run as ->NiOs II Hardware时出现错误：
NO NiOs II target cOnnectiOn paths were ...
-
NiOsII 下载程序过程中出现以下提示信息：
Using cable "USB-Blaster [USB0]", device ...
-
任务、函数的定义和调用都包括在一个mOdule的内部，他们一般用于行为级建模，在编写Testbench时用的较多，而在写可综合的代码时要少用。
functiOn的定义：
fun...
-
选择File->COnvert PrOgramming Files...
PrOgramming File Type选择JTAG Indirect COnfigurat...
-
复位对于FPGA设计很重要，一些很奇怪而找不到原因的问题很有可能是由于复位造成的，本人就因为没理解好复位情况而受困扰几天。
复位信号可以是高电平也可以是低电平复位。并且电路分外部...
-
几乎每个FPGA设计都离不开复位，但很多工程师都没有真正关心过复位的设计。当你遇到一些奇怪的问题，也许就是由复位不当引起的。
对于同步单元，可以选择同步复位、异步复位或者不复位。...
-
自动生成Tcl文件
PrOject -> Generate Tcl File fOr PrOject...
弹出如下对话框，设置脚本路径。
...
-
WARNING:PhysDesignRules:372 - Gated clOck. ClOck net rd_en&n...
畅学电子
